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| QuartusII로 구현한 small MIPS Processor ( Verilog HDL ) |
Tech - https://ohyung.net/387 (YMD: 07/05/28 10:10)
Single Cycle로 구현한 small MIPS Processor 입니다.

총 3 개의 소스를 첨부하였으며, 기존의 32bit-RCA 와 ALU, Registerfiles를 프로젝트 내에 추가 하여 합성하면 됩니다.

inst_rom.v의 내용은 1~9까지의 합을 도출하는것으로 결과값으로 45 혹은 h2D가 나오게 됩니다.

이전 Verilog HDL 소스와 마찬가지로 상업적 이용은 안됩니다.





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